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MyFPGA Forum»论坛首页 › FPGA技术汇 › FPGA设计基础 › Verilog/VHDL HDL › VHDL 描述的自较验测试的简单例子
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VHDL 描述的自较验测试的简单例子

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jklm164
1#
发表于 2011-7-28 14:13:07 | 显示全部楼层

顶

不错，顶顶顶，呵呵！
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