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【FAQ】为什么C5G 的LPDDR2_CA6 接FPGA的非DQ/DQS group脚?是弄错?

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发表于 2022-10-13 15:10:40 | 显示全部楼层 |阅读模式
本帖最后由 Doreen 于 2022-10-13 15:29 编辑

Q: 请问C5G 板子的LPDDR2_CA6 为什么是接到FPGA 的 非DQ/DQS group(PGA 的AE9引脚), 是不是搞错了?

A:CA 是Command/address inputs (截图来自 C5G_v.1.2.2_SystemCD\Datasheet\LPDDR2\U80M_4Gb_mobile_lpddr2_s4_sdram.pdf):
企业微信截图_20221013150946.png
这是专用的pin, 应用上必须选择HMC (截图来自  https://www.intel.com/content/da ... clone-v/5cgxfc5.xls):
image_2022_10_13T06_24_49_937Z.png

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