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标题: 【FAQ】为什么C5G 的LPDDR2_CA6 接FPGA的非DQ/DQS group脚？是弄错？ [打印本页]

作者: Doreen 时间: 2022-10-13 15:10
标题: 【FAQ】为什么C5G 的LPDDR2_CA6 接FPGA的非DQ/DQS group脚？是弄错？
本帖最后由 Doreen 于 2022-10-13 15:29 编辑

Q: 请问C5G 板子的LPDDR2_CA6 为什么是接到FPGA 的非DQ/DQS group（PGA 的AE9引脚），是不是搞错了？

A：CA 是Command/address inputs (截图来自 C5G_v.1.2.2_SystemCD\Datasheet\LPDDR2\U80M_4Gb_mobile_lpddr2_s4_sdram.pdf)：

这是专用的pin，应用上必须选择HMC (截图来自 https://www.intel.com/content/da ... clone-v/5cgxfc5.xls)：

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